Novel System Architecture Design

Prof. Dr. Estela Suarez

Joint Lead of JSC-Division "Novel System Architecture Design"

  • Institute for Advanced Simulation (IAS)
  • Jülich Supercomputing Centre (JSC)
Gebäude 16.4 /
Raum 222
+49 2461/61-9110
E-Mail

Dr. Andreas Herten

Head of ATML Accelerating Devices

  • Institute for Advanced Simulation (IAS)
  • Jülich Supercomputing Centre (JSC)
Gebäude 16.3 /
Raum 228
+49 2461/61-1825
E-Mail

Die NOVAS-Abteilung entwickelt neuartige Computerarchitekturen und erforscht Technologien für High-Performance Computing (HPC). Besonderes Augenmerk liegt auf Co-Design, Test und Integration energieeffizienter Prozessor- und Beschleunigertechnologien für HPC (Arm- und RISC-V-CPUs, GPUs, KI-Beschleuniger) unter Nutzung der Modular Supercomputing Architecture (MSA). Der Stack der System-Software für heterogene und MSA-Architekturen wird ebenfalls in NOVAS entwickelt. Darüber hinaus werden Schulungen und Unterstützung für Nutzer dieser neuen Technologien angeboten.

Die Abteilung ist eingeteilt in die folgenden Gruppen:

Unsere Forschungsfelder beinhalten:

  • Entwicklung der Modularen Supercomputing-Architektur (MSA):
    • Erforschung von Prozessortechnologie und Benchmarking
    • Prototypentwicklung von Hardware
    • Entwicklung von Systemsoftware
    • Portierung von Applikationen
  • GPU-Nutzung auf großen Skalen und Benutzerunterstützung:
    • Test und Benchmarking von GPU-Technologie
    • Portierung von Applikationen und Skalierung auf Multi-GPU-Systeme
    • Trainieren von großen Sprachmodellen (LLM) auf GPUs
    • Unterstützung von GPU-Nutzern und Ausrichtung von Trainingkursen
  • System-Software-Entwicklung:
    • System-Software für MSA-Systeme
    • Ressourcenmanagement und Scheduling auf heterogenen Architekturen
    • Entwicklung für Arm- und RISC-V-Systeme
  • Benchmarking und Co-Design:
    • Analyse von Metriken von HPC-Systemen
    • Evaluation von neuartigen Prozessoren und Systemarchitekturen und Portierung von Applikationen darauf
    • Portierung von HPC-Bibliotheken auf RISC-V-Prozessoren und Evaluation
    • Modellierung von HPC-Prozessoren mittels Gem5

Abteilungsmitglieder

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Letzte Änderung: 28.03.2024
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